Karena masalah pada Perangkat Lunak Intel® Quartus® Prime Edisi Pro v21.4, Anda mungkin melihat galat internal berikut ketika desain menggunakan clock dari beberapa input partisi yang sebenarnya terhubung ke sumber clock datar yang sama.
Galat Internal: Sub-sistem: LAB, File: /quartus/legality/lab/lab_fm_40_config_creator_module.cpp, Baris: 1513
PEMECAH LCB TIDAK DAPAT MENEMUKAN SOLUSI. PERIKSA DEBUG
LCB ilegal terdeteksi.
Modifikasi ke netlist atom yang tidak dilegalkan dibuat dalam Tahap: Retime.
Masalah ini memengaruhi desain yang menargetkan perangkat Intel Agilex® FPGA.
Untuk mengatasi masalah ini di Intel® Quartus® Perangkat Lunak Prime Edisi Pro versi 21.4, gabungkan port input terduplikasi tersebut menjadi satu.
Masalah ini telah diperbaiki dimulai dengan Intel® Quartus® Perangkat Lunak Prime Edisi Pro versi 22.2.