File MAX® V BSDL

Jelajahi file boundary-scan description language (BSDL) menurut perangkat tertentu dan pilih paket perangkat yang sesuai. File BSDL yang sama dapat digunakan terlepas dari tingkat kecepatan atau suhu.

{"collectionRelationTags":{"relations":{"OR":["etm-C29F58D8-B31D-4109-B8FC-F6D026341F6C","etm-9A05AA22-DCA0-413D-BFCE-F341DA4FFAA5"],"EXCLUDE":["etm-f6e0d09943a943d383e81b5f64a3956c","etm-ececc448f2f54f0e87cdf5558856b275"],"AND":["etm-081db853a9a148959ca49c264f8ee5be"]},"featuredIds":[]},"collectionId":"653181","resultPerPage":50.0,"filters":[{"facetId":"@stm_10309_id","field":"stm_10309_id","type":"hierarchical","basePath":"Technology","displayName":"Technology","deprecated":false,"rootFilter":"","position":0},{"facetId":"fpgadevicefamily","type":"fpgadevicefamily","deprecated":true,"name":"fpgadevicefamily","position":1},{"facetId":"lastupdated","type":"lastupdated","deprecated":true,"name":"lastupdated","position":2}],"coveoRequestHardLimit":"1000","accessDetailsPagePath":"/content/www/us/en/secure/design/internal/access-details.html","collectionGuids":["etm-081db853a9a148959ca49c264f8ee5be"],"cardView":false,"sorting":"Newest","defaultImagesPath":"/content/dam/www/public/us/en/images/uatable/default-icons","coveoMaxResults":5000,"coveoSplitSize":500,"fpgaFacetRootPaths":"{\"fpgadevicefamily\":[\"Primary Content Tagging\",\"Intel® FPGAs\",\"Intel® Programmable Devices\"],\"quartusedition\":[\"Primary Content Tagging\",\"Intel® FPGAs\",\"Intel® Quartus Software\"],\"quartusaddon\":[\"Primary Content Tagging\",\"Intel® FPGAs\",\"Intel® Quartus Software - Add-ons\"],\"fpgaplatform\":[\"Primary Content Tagging\",\"Intel® FPGAs\",\"Intel® FPGA Platforms\"]}","newWrapperPageEnabled":true,"descendingSortingForNumericalFacetsName":"[\"Intel® Quartus® Prime Pro Edition\",\"Intel® Quartus® Prime Lite Edition\",\"Intel® Quartus® Prime Standard Edition\",\"Quartus® II Subscription Edition\",\"Quartus® II Web Edition\"]","columnsConfiguration":{"idColumn":true,"dateColumn":true,"versionColumn":true,"contentTypeColumn":false,"columnsMaxSize":0},"dynamicColumnsConfiguration":[{"name":"DynamicColumn_id","type":"id","gtv":"ID","width":60,"selected":true},{"name":"DynamicColumn_date","type":"date","gtv":"Tanggal","width":60,"selected":true},{"name":"DynamicColumn_version","type":"version","gtv":"OS","width":135,"selected":true}],"updateCollateralMetadataEnabled":true,"relatedAssetsEnable":true,"disableExpandCollapseAll":false,"enableRelatedAssetsOnExpandAll":false,"disableBlueBanner":false,"isICS":false,"isUPE":false}

Nota

1File BSDL diperiksa sintaksnya menggunakan alat ini:

  • Teknologi JTAG
  • ASSET Intertech - Teknologi Agilent
  • Corelis
  • Goepel elektronik
  • Sistem Temento

Jika Anda memiliki pertanyaan, Anda dapat menemukan opsi dukungan yang tersedia di Dukungan Pelanggan Intel®. Pelanggan Intel dengan Dukungan Intel® Premier dapat menemukan topik pelatihan dan bantuan di Dukungan Intel® Premier.

Anda juga dapat menelusuri Komunitas Intel® untuk mengajukan dan menjawab pertanyaan tentang rangkaian produk FPGA dan Solusi yang Dapat Diprogram.

Untuk informasi tentang pengujian pemindaian batas, lihat tautan Dokumen Terkait di Dukungan BSDL Intel® FPGA.

Isi halaman ini adalah kombinasi terjemahan manusia dan komputer dari konten berbahasa Inggris. Konten ini diberikan hanya untuk kenyamanan Anda serta sebagai informasi umum dan tidak bisa dianggap sebagai lengkap atau akurat. Jika terdapat kontradiksi antara versi bahasa Inggris halaman ini dan terjemahannya, versi bahasa Inggris akan didahulukan. Lihat versi bahasa Inggris halaman ini.