Karena masalah dalam Low Latency 40- dan 100-Gbps Ethernet IP Core, sinyal rx_pcs_ready dari inti kadang-kadang terjebak terhapus saat start-up. Masalah ini berarti blok PCS RX tidak muncul dengan benar. Gejala kadang-kadang menghilang jika FPGA dikonfigurasi ulang.
Masalahnya hanya ada pada perangkat keras dan tidak muncul dalam simulasi. Ini adalah masalah start-up saja. Setelah rx_pcs_ready tinggi, Ethernet IP Core bekerja dengan benar.
Untuk mengatasi masalah ini, Anda dapat mengkompilasi ulang proyek Quartus® Prime dengan benih waktu yang berbeda. Peluang untuk mengalami masalah ini dengan seed yang berbeda rendah.
Masalah telah diperbaiki dimulai dengan pembaruan perangkat lunak Quartus Prime versi 16.1 2.