Untuk daftar batasan yang didukung, lihat bab Dukungan FPGA Synopsys DC di Volume 1 Buku Panduan Quartus II
Dapatkah saya menggunakan skrip sintesis Synopsys Design Compiler (DC) ASIC yang ada untuk sintesis FPGA dalam perangkat lunak FPGA DC?
1
Pelepasan tanggung jawab
Semua posting dan penggunaan konten di situs ini tunduk pada Syarat Penggunaan Intel.co.id.
Isi halaman ini adalah kombinasi terjemahan manusia dan komputer dari konten berbahasa Inggris. Konten ini diberikan hanya untuk kenyamanan Anda serta sebagai informasi umum dan tidak bisa dianggap sebagai lengkap atau akurat. Jika terdapat kontradiksi antara versi bahasa Inggris halaman ini dan terjemahannya, versi bahasa Inggris akan didahulukan. Lihat versi bahasa Inggris halaman ini.