Ya, karena masalah dalam Intel® Quartus® Prime Pro Edition Software versi 17.1 dan sebelumnya, I/Os 3V di Intel® Stratix® 10 FPGAs dapat mengusir HIGH yang kuat selama konfigurasi saat pin ditetapkan sebagai output dalam desain yang dikompilasi.
Perilaku ini tidak terlihat ketika I/Os 3V ditetapkan sebagai input atau I/Os dwiarah.
I/Os 3V ini terletak di bank I/O 6A,6B,6C,7A,7B,7C, dan tersedia dalam varian densitas dan paket yang berbeda dari Intel Stratix 10 perangkat.
Masalah ini dijadwalkan akan diperbaiki dalam rilis Intel Quartus Perangkat Lunak Edisi Prime Pro di masa mendatang.