Masalah Kritis
Masalah ini memengaruhi antarmuka DDR3 dan DDR4 menggunakan Ping Fitur Pong PHY pada Arria 10 perangkat.
Mengatur pelanggaran waktu untuk transfer dari hard sekunder kontroler memori ke logika inti mungkin terjadi pada antarmuka menggunakan Instantiate dua kontroler yang berbagi opsi PHY Ping-Pong , di memori frekuensi clock lebih cepat dari 1067 MHz.
Solusi untuk masalah ini adalah untuk menentukan memori yang lebih lambat frekuensi clock.
Masalah ini diperbaiki pada versi 15.1.